笔记本开机原理
互联网 发布时间:2008-11-28 22:34:05 作者:佚名
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整个笔记本的开机过程分为硬件启动和软件启动﹐硬启动是指POWER的动作过程﹒而软启动部分是指BIOS的POST过程﹒先是硬件启动而后是软件启动了解微机的开机过程,对主板功能维修是很重要的,因为很多功能不良板﹐特别是当机板,可以根据开
整个笔记本的开机过程分为硬件启动和软件启动﹐硬启动是指POWER的动作过程﹒而软启动部分是指BIOS的POST过程﹒先是硬件启动而后是软件启动了解微机的开机过程,对主板功能维修是很重要的,因为很多功能不良板﹐特别是当机板,可以根据开机的顺序从而判断系统哪部分有问题﹐如果是无显示的板﹐可以从DEBUGE CARD上诊断系统运行的地址﹒可以使分析问题做到有的放失,不至于瞎子摸象
硬件启动原理
在常态下POWER中的PS-ON是高电平,只有当PS-ON处于低电平时,POWER开始工作.如上图,在常态时,SOUTHBRIDGE的SUSC#应为高电平,因为此信号是低电平有效,此时三极管的极基为低电平,三极管截止,5V-SB直接加到PS-ON,使电源保持常态.POWER无法送出PG信号给SOUTH BRIDGE,系统无法工作.当POWER BUTTON BOARD触发有效时﹐SUSC#为低电平,此时三极管的基极为高电平导通,5V-SB直接接地,从而PS-ON被拉低,POWER工作,同时向SOUTH BRIDGE,NOTTHBRIDGE及CPU发送PG信号,当SOUTH接到PG,CLOCK GENERATION送来的CLOCK开始工作,并输出RESET#到ISA,PCI,AGP总线,NORTH? BRIDGE收到PG,PCI RESET#及CLOCK后输出CORREST#给CPU,CPU接到CORREST#信号﹐开始动作并送出FFFFFFF0地址经南﹐北桥指向BIOS.硬件启动部分到此结束,系统启动权交由BIOS.进入软启动状态
软启动过程
软件启动过程主要是BIOS(Base Input Output System)的POST(Power On Self Test-上电自检).CPU工作后,系统的高端内存的分布如下
…………………..
A0000…BFFFF:为 VIDEO? MEMORY
C0000…C7FFF:为 VGA BIOS
C8000…CFFFF:为 I/O ROM
D0000…DFFFF为 Optional ROM & Buffer Area
E0000…FFFFF:为 系统BIOS
CPU复位时,将CS=FFFF,IP=0000,准备从FFFF0处进行POST自检程序,称为FETCH CODE.CPU在每一个FETCH CODE周期会连续发出32个20位地址(分8次从PCI总在线取得数据,运行1次所取得的数据以PCI上的TRDY和IRDR信号为标志,而期间SOUTH BRIDGE负责将每个地址传送到ISA总线并从BIOS中获取数据,由于BIOS上的仅有8位数据,而PCI BUS 为32为总线,故SOUTH BRIDGE每读BIOS数据4次(以I/O TRDY#为标志)才发出TRDY和IRDY信号向CPU传送,传送8次后,CPU从FFFF0开始执行数据中的代码,其后,进行下一次的FETCH CODE.CUP正是以这样的方式完成BIOS的整个POST过程.
硬件启动原理
在常态下POWER中的PS-ON是高电平,只有当PS-ON处于低电平时,POWER开始工作.如上图,在常态时,SOUTHBRIDGE的SUSC#应为高电平,因为此信号是低电平有效,此时三极管的极基为低电平,三极管截止,5V-SB直接加到PS-ON,使电源保持常态.POWER无法送出PG信号给SOUTH BRIDGE,系统无法工作.当POWER BUTTON BOARD触发有效时﹐SUSC#为低电平,此时三极管的基极为高电平导通,5V-SB直接接地,从而PS-ON被拉低,POWER工作,同时向SOUTH BRIDGE,NOTTHBRIDGE及CPU发送PG信号,当SOUTH接到PG,CLOCK GENERATION送来的CLOCK开始工作,并输出RESET#到ISA,PCI,AGP总线,NORTH? BRIDGE收到PG,PCI RESET#及CLOCK后输出CORREST#给CPU,CPU接到CORREST#信号﹐开始动作并送出FFFFFFF0地址经南﹐北桥指向BIOS.硬件启动部分到此结束,系统启动权交由BIOS.进入软启动状态
软启动过程
软件启动过程主要是BIOS(Base Input Output System)的POST(Power On Self Test-上电自检).CPU工作后,系统的高端内存的分布如下
…………………..
A0000…BFFFF:为 VIDEO? MEMORY
C0000…C7FFF:为 VGA BIOS
C8000…CFFFF:为 I/O ROM
D0000…DFFFF为 Optional ROM & Buffer Area
E0000…FFFFF:为 系统BIOS
CPU复位时,将CS=FFFF,IP=0000,准备从FFFF0处进行POST自检程序,称为FETCH CODE.CPU在每一个FETCH CODE周期会连续发出32个20位地址(分8次从PCI总在线取得数据,运行1次所取得的数据以PCI上的TRDY和IRDR信号为标志,而期间SOUTH BRIDGE负责将每个地址传送到ISA总线并从BIOS中获取数据,由于BIOS上的仅有8位数据,而PCI BUS 为32为总线,故SOUTH BRIDGE每读BIOS数据4次(以I/O TRDY#为标志)才发出TRDY和IRDY信号向CPU传送,传送8次后,CPU从FFFF0开始执行数据中的代码,其后,进行下一次的FETCH CODE.CUP正是以这样的方式完成BIOS的整个POST过程.
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